コンピュータ構成要素
基本情報技術者試験|アムダールの法則が示す、プロセッサのコア数を増やして並列化したときの性能向上に関する説明
アムダールの法則が示す、プロセッサのコア数を増やして並列化したときの性能向上に関する説明として最も適切なものはどれか。
ア逐次処理として残る部分が全体の高速化の上限を決めるため、コアを増やしても向上は頭打ちになる
イコア数に正比例して処理性能はどこまでも線形に向上し続ける
ウ並列化の効果はコア数の2乗に比例して加速度的に増大する
エコア数を増やしさえすれば逐次部分までも自動的に並列化され、全体の処理時間が限りなくゼロに近づいていく
正解
ア.逐次処理として残る部分が全体の高速化の上限を決めるため、コアを増やしても向上は頭打ちになる
アムダールの法則は、プログラム中の逐次実行しかできない部分の割合が全体の高速化の上限を定めると述べる。並列部分をいくら速くしても逐次部分は短縮されないため、コアを増やしても向上が頭打ちになる。設問に合致し正しい。
?選択肢ごとの解説
ア ○アムダールの法則は、プログラム中の逐次実行しかできない部分の割合が全体の高速化の上限を定めると述べる。並列部分をいくら速くしても逐次部分は短縮されないため、コアを増やしても向上が頭打ちになる。設問に合致し正しい。
イ ×コア数に正比例して線形に向上し続けるという説明は逐次部分の存在を無視しており、現実には頭打ちが生じるためアムダールの法則に反する。
ウ ×コア数の2乗に比例して加速するという説明は根拠がなく、並列化の効果は逐次部分に制約されるため成立しない。
エ ×逐次部分まで自動的に並列化され処理時間がゼロに近づくという説明は誤りで、逐次部分は本質的に並列化できず残り続ける。
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作成・校閲:ukamiru編集部 · 基本情報技術者試験 過去問 · fe-a3-0155
